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# Ingeniero/a de Diseño ASIC

- **Company:** Gmv
- **Location:** Madrid, Spain (Remote available)
- **Contract:** Apprenticeship
- **Skills:** Logic Synthesis of Circuits, Field-Programmable Gate Array (FPGA), Reduced Instruction Set Computing, SystemVerilog, Verilog, VHSIC Hardware Description Language (VHDL), Vivado, Application Specific Integrated Circuits, Backend, Information Technology, GNSS
- **Published:** July 25, 2026
- **Apply:** https://www.adzuna.es/contact-us.html

## About the Role

Para este puesto, estamos buscando graduados en Ingeniería Electrónica, Telecomunicaciones, Informática o similar, con especialidad en el ámbito de la programación de hardware digital.
Adicionalmente, buscamos perfiles con conocimientos de diseño digital RTL, arquitecturas FPGA, SoC o MPSoC, buses internos, integración de IPs y verificación funcional, así como experiencia previa en flujo ASIC y manejo de herramientas de simulación y síntesis.
También valoraremos conocimientos previos de STA, DFT, scan, low-power, UPF, floorplanning o backend; verificación con SystemVerilog, UVM, assertions o cocotb; procesadores embebidos ARM/RISC-V y particionado hardware/software; y experiencia con herramientas Synopsys, Cadence, Siemens EDA, Vivado o Vitis., + Técnico

 + Recepciónista
 + Administrador
 + Ventas
 + Enfermero
 + Limpieza
 + Mantenimiento
 + Telefonista
 + Compras
 + Recursos humanos

Tipo de trabajo

 + Desde casa
 + Estudiantes
 + Online
 + Trabajos Verticales
 + En inglés
 + Teletrabajo
 + Media jornada

## Description

Estamos ampliando nuestros equipos en la unidad de Navegación GNSS-User Segment para asumir proyectos relacionados con la tecnología de receptores., Como parte del equipo de Receptores de GMV, tendrás un rol clave entre proyectos relacionados con la tecnología
de receptores, contribuyendo al desarrollo de proyectos y productos con una fuerte participación en actividades de I+D.
Principalmente participarás en la migración de una arquitectura actualmente implementada sobre Xilinx MPSoC / FPGA hacia una solución ASIC. Además, tendrás la oportunidad de trabajar en el análisis del diseño existente, identificación de bloques reutilizables, adaptación de la arquitectura hardware y definición del flujo de implementación ASIC.
Tus principales tareas serían:

 + Definir y evolucionar la arquitectura objetivo para ASIC.
 + Desarrollar y adaptar bloques RTL (VHDL/Verilog/SystemVerilog).
 + Analizar y optimizar interfaces internas (buses, memorias, sincronización, clocks y resets).
 + Participar en verificación funcional, simulación y depuración del diseño.
 + Contribuir al flujo ASIC: síntesis, análisis temporal, CDC/RDC, DFT y cierre de diseño.
 + Documentar arquitectura, decisiones técnicas y resultados de validación., Al crear una alerta, aceptas nuestros Términos y condiciones y Política de privacidad, y el uso de cookies., Alemania Australia Austria Bélgica Brasil Canadá España Estados Unidos Francia India Italia México Nueva Zelanda Holanda Polonia Reino Unido Singapur Sudáfrica Suiza


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