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# Ingénieur Design FPGA Expérimenté - F/H

- **Company:** Enseigne Anonyme
- **Location:** Calmont, France (Remote available)
- **Experience:** Starter
- **Salary:** €40,000 - €55,000
- **Contract:** Permanent contract
- **Skills:** Bash Shell, Digital Electronics, Embedded C, Perl (Programming Language), Field-Programmable Gate Array (FPGA), Python (Programming Language), Tcl (Programming Language), VHSIC Hardware Description Language (VHDL), Wintel, Vivado, Scripting, Application Specific Integrated Circuits, ModelSim
- **Published:** November 10, 2026
- **Apply:** https://candidat.francetravail.fr/offres/recherche/detail/8649453

## About the Role

* Issu-e d'une formation Ingénieur/Master 2 en électronique numérique, et vous êtes opérationnel en conception sur FPGA et justifiez d'au moins 5 ans d'expérience en conception et/ou vérification FPGA/ASIC.

Vous devez maîtriser :

 * Le design RTL en VHDL
 * La simulation et les outils associés (ModelSim ou équivalent)
 * La vérification FPGA
 * Les suites Vivado (Xilinx) et/ou Quartus Prime (Intel Altera) ou d'autres outils équivalents.
 * L'implantation sur cible physique et la validation.
 * Des compétences complémentaires en scripting (TCL, Bash, Perl ou Python) sont un atout non négligeable.
 * Enfin, une connaissance solide des architecture SoC, des bases en C embarqué et en architecture électronique numérique seront appréciées.

Nous recherchons des ingénieur-e-s motivé-e-s par les défis techniques et souhaitant continuer leur montée en compétences sur les métiers de la microélectronique numérique. Vous devrez être capable de faire preuve d'autonomie et être capable de travailler en équipe. Si vous voulez rejoindre une équipe de passionnés dans laquelle vous pourrez progresser techniquement, n'hésitez pas à candidater !

## Description

Au sein d'une équipe de spécialistes en la matière vous interviendrez sur l'ensemble des étapes du flot de conception FPGA sur des cibles de dernières générations (SoC).

Vous serez amenés à travailler sur la conception, le design RTL en VHDL, les étapes de simulation, de synthèse, et de validation sur carte.

Vous serez donc confronté-e aux différentes étapes du cycle en V, pour des systèmes embarqués avec un environnement critique et durci.