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# Ingénieur Design Asic H/F

- **Company:** ELSYS Design
- **Location:** Sophia Antipolis, France
- **Salary:** €30,000 - €40,000
- **Contract:** Permanent contract
- **Skills:** Microarchitecture, Software Debugging, SystemVerilog, Verilog, VHSIC Hardware Description Language (VHDL), Application Specific Integrated Circuits
- **Published:** November 11, 2026
- **Apply:** https://www.hellowork.com/fr-fr/emplois/85365299.html

## About the Role

Maitrise d'un langage de description RTL (Verilog ou VHDL, SystemVerilog)

 - Première expérience en développement d'ASIC

 - Connaissance en optimisation consommation power

 - Anglais courant (écrit et oral), Chez ELSYS Design, nous sommes tous ingénieurs, votre manager sera donc lui aussi issu de la technique. Il veillera à vous proposer des projets pertinents qui vous permettront de vous constituer une expérience riche, bâtie sur un socle de compétences recherchées.

Vous aimez relever des défis techniques ? Vous avez envie d'évoluer dans une ambiance humaine, bienveillante et responsabilisante ? D'intégrer une structure familiale, présentant les avantages d'un grand groupe ?

## Description

La mission consiste à prendre en charge le design d'un ou plusieurs blocs d'un circuit de traitement video :

Les principaux objectifs du poste sont :

 - Participer à la définition de la micro-architecture

 - Rédiger les spécifications fonctionnelles de sous-ensembles du circuit

 - Implémenter la description RTL de ces blocs (VHDL voire SystemVerilog)

 - Assurer une bonne intégration au niveau top level

 - Suivi de la vérification fonctionnelle (Debug et correction)

 - Suivi et correction pour l'implémentation physique

L'agence de rattachement de cette offre se situe à Nice Sophia-Antipolis.