Ingénieur en Implémentation Physique Backend sur Cible Asic - Soc H/F

Implémentation Physique (Synthèse vers GDSII) :

Conduire l’ensemble du processus d’implémentation physique, assurant une transformation efficace du design et de la synthèse vers le format GDSII.

Synthèse DC/DCTopo :

Maîtriser les outils d’implémentation physique orientés ASIC tels que IC Compiler de Synopsys et Innovus de Cadence pour optimiser les performances du design tout en respectant les contraintes.

DFT (Design For Testability) :

Intégrer des techniques de DFT pour garantir la testabilité du produit final, en mettant en oeuvre des mécanismes de test efficaces.

Vérifications d’équivalence et Simulation Gate-Level :

Exécuter des vérifications d’équivalence à différentes étapes du flux de conception, tout en assurant des simulations gate-level pour valider le comportement du design.

Analyses Timings et Debug :

Mener des analyses minutieuses des timings pour optimiser les performances du circuit, tout en identifiant et résolvant rapidement les problèmes de conception.

Placement, optimisation, synthèse de l’arbre d’horloge et routage :

Superviser le placement stratégique des composants, l’optimisation globale du design, la synthèse de l’arbre d’horloge et le routage, garantissant ainsi une intégrité du signal optimale.

Vérifications d’approbation :

Initier des vérifications rigoureuses pour garantir que le design répond aux normes requises, assurant ainsi que la puce puisse être fabriquée avec succès.

Ecriture du GDSII :

Finaliser le processus en générant le fichier GDSII, prêt à être utilisé dans la phase de fabrication.

Ingénieur(e) de formation avec une solide expérience en implémentation physique sur des cibles ASIC/SOC.

• Maitrise des outils tels que IC Compiler de Synopsys et Innovus de Cadence.

• Compétence avancée dans le langage TCL ou Python.

• Connaissance approfondie des langages Verilog et/ou SystemVerilog.

• Expérience dans l’implémentation de blocs en technologie avancée (40, 28nm…) et de floorplanning d’ASIC complexes (15M d’instance et +…).

• Maîtrise de l’anglais (écrit et oral) pour une coopération efficace avec des ingénieurs anglophones., Chez ELSYS Design, nous sommes tous ingénieurs, votre manager sera donc lui aussi issu de la technique. Il veillera à vous proposer des projets pertinents qui vous permettront de vous constituer une expérience riche, bâtie sur un socle de compétences recherchées.

Vous aimez relever des défis techniques ? Vous avez envie d’évoluer dans une ambiance humaine, bienveillante et responsabilisante ? D’intégrer une structure familiale, présentant les avantages d’un grand groupe ?

10 jours de RTT par an

• Allocation repas ou Titre restaurant presque intégralement pris en charge

• Mutuelle Santé Famille

• Compte Epargne Temps

• Participation et Intéressement

• Prime de cooptation de 1000 ou 1500 €

• Prime de vacances
• Prime Transport de 200 € net par an et 50 € brut mensuel.

L’agence de rattachement de cette offre se situe à Nice-sophia-antipolis.

L’agence de rattachement de cette offre se situe à Nice Sophia-Antipolis., ELSYS Design est une société d’ingénierie spécialisée dans la conception de systèmes électroniques embarqués.

Nous accompagnons nos clients issus de secteurs variés (énergie, semiconducteur, défense, spatial, transport, etc.) dans 4 domaines principaux : la microélectronique (FPGA, ASIC, SoC), la carte, le logiciel embarqué et l’ingénierie système.